DC综合要注意哪些问题

2025-05-08 20:30:25

1、设置时钟CLK约束时尽量约束的紧一些,一般会约束紧20%,例如要跑100MHZ,可以约束为120MHZ,不要忘了加入uncertainty等参数,注意跨时钟域的问题,注意不同时钟的问题。

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3、注意观察综合后的文件,如果set_up (建立时间)time的slack(余量)为蚩距粼讨负值的话可能需要修改代码,具体的是找到关键路劲,然后插入DFF(触发器)或者利吹涡皋陕用register_balancing(寄存器平衡的方式,工具自动调整触发器的位置)的方式。

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5、注意综合时工艺库的选择,要选择合适的工艺库,不然综合的结果可能达不到要求,必须回去重新修改代码,这样的代价比较大,或者ECO,但是难度比较大。

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